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LTC4214-1/LTC4214-2
24
421412f
APPLICATIO  S I FOR  ATIO
U
U
U
Figure 12. Overvoltage Timing (All Waveforms are Referenced to V
EE
)
OV
TIMER
GATE
SENSE
SS
5礎
50礎
50礎
5礎
1
2 34    5   67 8 9
4214 F12
OV DROPS BELOW V
OVHI
  V
OVHST
, CHECK GATE < V
GATEL
, SENSE < V
CB
 AND SS < 20 " V
OS
OV OVERSHOOTS V
OVHI
. GATE AND SS ARE PULLED DOWN, PWRGD AND TIMER ARE UNAFFECTED
V
ACL
V
CB
40礎 + 8 " I
DRN
20 " V
OS
V
IN
  V
GATEH
20 " (V
CB
 + V
OS
)
20 " (V
ACL
 + V
OS
)
V
GATEL
V
OVHI
V
TMRH
GATE
START-UP
V
OVHI
  V
OVHST
Overvoltage Timing
During normal operation, if the OV pin exceeds V
OVHI
 as
shown at time point 1 of Figure 12, the TIMER and PWRGD
status are unaffected. Nevertheless, SS and GATE pull
down and the load is disconnected. At time point 2, OV
recovers and drops below the V
OVHI
 V
OVHST
 threshold. A
GATE start-up cycle begins. If the overvoltage glitch is
long enough to deplete the load capacitor, a full start-up
cycle as shown between time points 4 through 7 may
occur.
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